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2018-01-18 15页 doc 40KB 48阅读

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起名字 取名字大全女孩 取英文名字 起名字取名字大全女孩取英文名字怎么取名字取名字软件 想真正了解你的姓名?姓名测试可以一试~我的2010虎年运势,开始测试~硬件师面试试题模仿电路1、基尔霍夫定理的形式是什么?(仕兰微电子)?I=0?E=?RI 2、平板电容公式(C=εS/4πkd)。(未知)3、最根基的如三极管曲线特。(未知)4、描写反应电路的概念,罗列他们的应用。(仕兰微电子)5、负反应品种(电压并联反应,电流串联反应,电压串联反应和电流并联反应);负反馈的益处(低落缩吝惜的增益生动度,转折输入电阻和输入电阻,改善缩吝惜的线和非线失真,有用地扩展缩吝惜的通频带,主动调理作用)(未知)6、缩小电路的频次抵偿的目的是什么,有哪些方?(仕兰微电子)7、频次反响,如:怎样才算是稳定的,如何转折频响曲线的几个方。(未知)8、给出一个查分运放,如何相位抵偿,并画抵偿后的波特图。(凹凸)9、根基缩小电路品种(电紧缩吝惜,电流缩吝惜,互导缩吝惜和互阻缩吝惜),缺点,异常是寻常采用差分的原故。(未知)10、给出一差分电路,报告其输入电压Y+和Y-,求共模重量和差模重量。(未知)11、画差放的两个输入管。(凹凸)12、画出由运放组加、减、微分、积分运算的电路原理图。并画出一个晶体管级的运放电路。(仕兰微电子)13、用运算缩吝惜组一个10倍的缩吝惜。(未知)14、给出一个大略电路,让理会输入电压的特(就是个积分电路),并求输入端某点的rise/fall时间。(Infineon口试试题)15、电阻R和电容C串联,输入电压为R和C之间的电压,输入电压分别为C上电压和R上电压,央求制这两种电路输入电压的频谱,判定这两种电路何为高通滤波器,何为低通滤波器。当RC T时,给出输入电压波形图,绘制两种电路的输入波形图。(未知)16、有源滤波器和无源滤波器的原理及区别?(新太硬件)17、有一时域信号 S=V0sin(2pif0t)+V1cos(2pif1t)+V2sin(2pif3t+90),当其通过低通、带通、高通滤波器后的信号表示方式。(未知)18、遴选电阻时要探究什么?(东信口试题)19、在CMOS电路中,要有一个单管作为开关管切确传达模仿低电平,这个单管会用P管还是N管,为什么?(仕兰微电子)20、给出多个mos管组的电路求5个点的电压。(Infineon口试试题)21、电压源、电流源是集电路中通常用到的模块,请画出知道的线路,大略描写其缺点。(仕兰微电子)22、画电流偏置 的发作电路,并疏解。(凹凸)23、史密斯特电路,求回差电压。(华为面试题)24、晶体振荡器,雷同是给出振荡频次让求周期(应当是单片机的,12分之一周期.)(华为面试题)25、LC正弦波振荡器有哪几种三点式振荡电路,分别画出其原理图。(仕兰微电子)26、VCO是什么,什么(压控振荡器?)(华为面试题)27、锁相环有哪几部门组?(仕兰微电子)28、锁相环电路组,振荡器(歧用D触发器如何搭)。(未知)29、求锁相环的输入频次,给了一个锁相环的图。(未知)30、假使公司做高频电子的,可能还要RF常识,调频,鉴频鉴相之类,不逐一罗列。(未知)31、一电源和一段传输线相连(长度为L,传输时间为T),画出终端处波形,探究传输线无消耗。给出电源电压波形图,央求绘制终端波形图。(未知)32、微波电路的立室电阻。(未知)33、DAC和ADC的竣工各有哪些方?(仕兰微电子)34、A/D电路组、作事原理。(未知)35、现实作事所须要的一 面试容易问到)。如电路的低耗,稳定,高速如何做到,调运放,些技术常识( 布领土注意的住址等等,通常会针对简历上所写做过的东西的确问,肯定会问得很细(所以别把什么都写上,醒目之类的词也别用太多了),这个东西各小我就不一样了,不好说什么了。(未知)_ _数字电路1、同步电路和异步电路的区别是什么?(仕兰微电子)2、什么是同步逻辑和异步逻辑?(汉王口试)同步逻辑是时钟之间有稳定的因果关联。异步逻辑是各时钟之间没有稳定的因果关联。3、什么是"线与"逻辑,要竣工它,在硬件特上有什么的确央求?(汉王口试)线与逻辑是两个输入信号相连可能竣工与的用。在硬件上,要用oc门来竣工,由于不消oc门可能使灌电流过大,而烧坏逻辑门。同时在输入端口应加一个上拉电阻。4、什么是Setup和Holdup时间?(汉王口试)5、setup和holdup时间,区别.(南山之桥)6、疏解setup time和holdtime的定义和在时钟信号耽搁时的变化。(未知)7、疏解setup和hold timeviolation,画图说明,并说明解决步骤。(威盛VIA 2003.11.06上海口试试题)Setup/hold time是测试芯片对输入信号和时钟信号之间的时间央求。作战时间是指触发器的时钟信号高涨沿到来以前,数据稳定不变的时间。输入信号应提早时钟高涨沿(如高涨沿有用)T时间到达芯片,这个T就是作战时间-Setup time.如满意足setup time,这个数据就不能被这一时钟打入触发器,唯有在下一个时钟高涨沿,数据能力被打入触发器。连结时间是指触发器的时钟信号高涨沿到来往后,数据稳定不变的时间。假使hold time不够,数据异样不能被打入触发器。作战时间(Setup Time)和连结时间(Hold time)。作战时间是指在时钟边沿前,数据信号须要连结不变的时间。连结时间是指时钟跳变边沿后数据信号须要连结不变的时间。 假使满意足作战和连结时间的话,那么DFF将不能正确地采样到数据,将会出现metastability的状。假使数据信号在时钟沿触发前后陆续的时间均超出作战和连结时间,那么超出量就分别被称为作战时间裕量和连结时间裕量。8、说说对数字逻辑中的角逐和冒险的理解,并举例说明角逐和冒险怎样扑灭。(仕兰微电子)9、什么是角逐与冒险形势?怎样判定?如何扑灭?(汉王口试)在组合逻辑中,由于门的输入信号通路中经过了不同的延时,招致到达该门的时间不相仿叫角逐。发作毛刺叫冒险。假使布尔式中有相同的信号则可能发作角逐和冒险形势。解决方:一是增加布尔式的消去项,二是在芯片内部加电容。10、知道那些常用逻辑电平?TTL与COMS电平可能间接互连吗?(汉王口试)常用逻辑电平:12V,5V,3.3V;TTL和CMOS不可能间接互连,由于TTL是在0.3-3.6V之间,而CMOS则是有在12V的有在5V的。CMOS输入接到TTL是可能间接互连。TTL 。11、如何解决亚稳接到CMOS须要在输入端口加一上拉电阻接到5V或者12V 态。(飞利浦-大唐口试)亚稳态是指触发器无在某个原则时间段内抵达一个可确认的形态。当一个触发器进入亚稳态时,既无预测该单元的输入电平,也无预测何时输入能力稳定在某个正确的电平上。在这个稳按时间,触发器输入一些中心级电平,或者可能处于振荡形态,并且这种无用的输入电平可能沿信号通道上的各个触发器级联式撒播上去。12、IC策画中同步复位与异步复位的区别。(南山之桥)13、MOORE与MEELEY形态机的特征。(南山之桥)14、多时域策画中,如何料理信号跨时域。(南山之桥)15、给了reg的setup,hold时间,求中心组合逻辑的delay限制。(飞利浦-大唐口试)Delay period-setup hold 16、时钟周期为T,触发器D1的作战时间最大为T1max,最小为T1min。组合逻辑电路最大延迟为T2max,最小为T2min。问,触发器D2的作战时间T3和连结时间应知足什么条件。(华为)17、给出某个通常时序电路的图,有Tsetup,Tdelay,Tck- q,还有clock的delay,写出决定最大时钟的分,同时给出表达式。(威盛VIA 2003.11.06上海口试试题)18、说说静态、静态时序模仿的缺点。(威盛VIA 2003.11.06上海口试试题)19、一个级的Mux,其中第二级信号为关键信号如何改善timing。(威盛VIA 2003.11.06上海口试试题)20、给出一个门级的图,又给了各个门的传输延时,问关键途径是什么,还问给出输入,使得输入依赖于关键途径。(未知)21、逻辑方面数字电路的卡诺图化简,时序(同步异步区别),触发器有几种(区别,点),全加器等等。(未知)22、卡诺图写出逻辑表达使。(威盛VIA 2003.11.06上海口试试题)23、化简 F(A,B,C,D)=m(1,3,4,5,10,11,12,13,14,15)的和。(威盛)24、please show the CMOS inverter schmatic,layout and its cross sectionwith P-well process.Plot its transfer curve(Vout-Vin)And also explain the operation region of PMOS and NMOS for each segment of the transfer -03.11.09)25、To design curve?(威盛口试题circuit design-beijing aCMOSinvertor with balance rise and fall time,please define the ration of channel width of PMOS and NMOS and explain?26、为什么一个轨 范的倒相器中P管的宽长比要比N管的宽长比大?(仕兰微电子)27、用mos管搭 出一个二输入与非门。(扬智电子口试)28、please draw the transistor level schematic of acmos 2input AND gate and explain which input has faster response for output rising edge.(less delay time)。(威盛口试题 circuit design-beijing-03.11.09)29、画出NOT,NAND,NOR的符号,真值表, 还有transistor level的电路。(Infineon笔试)30、画出CMOS的图,画出 to-one mux gate。(威盛VIA 2003.11.06上海口试试题)31、用一个二选tow- 一mux和一个inv竣工异或。(飞利浦-大唐口试)32、画出Y=A*B+C的cmos电 路图。(科广试题)33、用逻辑们和cmos电路竣工ab+cd。(飞利浦-大唐口 试)34、画出CMOS电路的晶体管级电路图,竣工Y=A*B+C(D+E)。(仕兰微电 子)35、使用4选1竣工F(x,y,z)=xz+yz'。(未知)36、给一个表达式 f=xxxx+xxxx+xxxxx+xxxx用最多数量的与非门竣工(现实上就是化简)。37、给 出一个大略的由多个NOT,NAND,NOR组的原理图,根据输入波形画出各点波形。 (Infineon口试)38、为了竣工逻辑(A XOR B)OR(C AND D),请选用以下逻辑中 的一种,并说明为什么?1)INV 2)AND 3)OR 4)NAND 5)NOR 6)XOR答案: NAND(未知)39、用与非门等策画全加器。(华为)40、给出两个门电路让理会异 同。(华为)41、用大略电路竣工,当A为输入时,输入B波形为…(仕兰微电 子)42、A,B,C,D,E举办投票,多半服从多数,输入是F(也就是假使A,B,C,D,E中1的个数比0多,那么F输入为1,否则F为0),用与非门竣工,输入数目 没无限制。(未知)43、用波形表示D触发器的用。(扬智电子口试)44、用传输 门和倒向器搭一个边沿触发器。(扬智电子口试)45、用逻辑们画出D触发器。 (威盛VIA 2003.11.06上海口试试题)46、画出DFF的图,用verilog竣工之。 (威盛)47、画出一种CMOS的D锁存器的电路图和领土。(未知)48、D触发器和 D锁存器的区别。(新太硬件面试)49、简述latch和filp-flop的异同。(未 知)50、LATCH和DFF的概念和区别。(未知)51、latch与register的区别,为 什么此刻多用register.行为级描写中latch如何发作的。(南山之桥)52、用D 触发器做个二分颦的电路.又问什么是形态图。(华为)53、请画出用D触发器竣工2倍分频的逻辑电路?(汉王口试)54、怎样用D触发器、与或非门组二分频电路?(东信口试)55、How many flip-flop circuits are needed to divide by 16?(Intel)16分频?56、用filp-flop和logic-gate策画一个1位加器,输入carryin和current-stage,输入carryout和next-stage.(未知)57、用D触发器做个4进制的计数。(华为)58、竣工N位Johnson Counter,N=5。(南山之桥)59、用熟习的策画方式策画一个可预置初值的7进制循环计数器,15进制的呢?(仕兰微电子)60、数字电路策画当然必问Verilog/VHDL,如策画计数器。(未知)61、BLOCKING NONBLOCKING赋值的区别。(南山之桥)62、写异步D触发器的verilog module。(扬智电子口试)module dff8(clk,reset,d,q);input clk;input reset;input[7:0]d;output[7:0]q;reg[7:0]q; else q=d;always@(posedge clk or posedge reset)if(reset)q=0; endmodule 63、用D触发器竣工2倍分频的Verilog描写?(汉王口试)module divide2(clk,clk_o,reset);input clk,reset;output clk_o;wire in;reg out;always@(posedge clk or posedge reset)if(reset)out=0;else out=in;assign in=~out;assign clk_o=out;endmodule 64、可编程逻辑器件在当代电子策画中越来越紧张,请问:a)所知道的可编程逻辑器件有哪些?b)试用VHDL或VERILOG、ABLE描写8位D触发器逻辑。(汉王口试)PAL,PLD,CPLD,FPGA。module dff8(clk,reset,d,q);input clk;input reset;input d;output q;reg q;always@(posedge clk or posedge reset)if(reset)q=0;else q=d;endmodule 65、请用HDL描写位的全加器、5分频电路。(仕兰微电子)66、用VERILOG或VHDL写一段代码,竣工10进制计数器。(未知)67、用VERILOG或VHDL写一段代码,竣工扑灭一个glitch。(未知)68、一个形态机的标题用verilog实现(不过这个形态机画的实在比力差,很容易曲解的)。(威盛VIA 2003.11.06上海口试试题)69、描写一个通讯号灯的策画。(仕兰微电子)70、画形态机,继承1,2,5分钱的卖报机,每份报纸5分钱。(扬智电子口试)71、策画一个主动售货机体例,卖soda水的,只能投进三种硬币,要正确的找回钱数。(1)画出fsm(无限形态机);(2)用verilog编程,语要契合fpga策画的央求。(未知)72、策画一个主动饮料售卖机,饮料10分钱,硬币有5分和10分两种,并探究找零:(1)画出fsm(无限形态机);(2)用verilog编程,语要契合fpga策画的央求;(3)策画工程中可使用的工具及策画大致历程。(未知)73、画出可能检测10010串的形态图,并verilog竣工之。(威盛)74、 用F竣工101101的序列检测模块。(南山之桥)a为输入端,b为输入端,假使a连续输入为1101则b输入为1,否则为0。例如a:0001100110110100100110 b:0000000000100100000000请画出state machine;请用RTL描写其state (未知)75、用verilog/vddl检测stream中的特定字符串(分形态用machine。 形态机写)。(飞利浦-大唐口试)76、用verilog/vhdl写一个fifo控制器(包括空,满,半满信号)。(飞利浦-大唐口试)77、现有一用户须要一种集电路产品,央求该产品能够竣工如下用:y=lnx,其中,x为4位二进制整数输入信号。y为二进制小数输入,央求保存两位小数。电源电压为3~5v假设公司接到该项目后,由来职掌该产品的策画,试辩论该产品的策画全程。(仕兰微电子)78、sram,falsh memory,及dram的区别?(新太硬件面试)79、给出单管DRAM的原理图(西电版《数字电子技术基础》作者杨颂华、冯毛官205页图9-14b),问 降高温度,有什么步骤进步refresh time,总共有5个问题,记不起来了。( 增大电容存储容量)(Infineon口试)80、Please draw schematic of acoon SRAM cell with 6transistors,point out which nodes can store data and which node is word line control?(威盛口试题circuit design-beijing-03.11.09)81、名词:sram,ssram,sdram名词IRQ,BIOS,USB,VHDL,SDR IRQ:Interrupt ReQuest BIOS:Basic Input Output System USB:Universal Serial Bus VHDL:VHIC Hardware Description Language SDR:Single Data Rate压控振荡器的英文缩写(VCO)。静态随机存储器的英文缩写(DRAM)。名词疏解,无聊的外文缩写已矣,歧PCI、ECC、DDR、interrupt、pipeline、IRQ,BIOS,USB,VHDL,VLSI VCO(压控振荡器)RAM(静态随机存储器),FIR IIR DFT(分割傅立叶变换)或者是中文的,歧:a.量化误差b.直方图c.白均衡_ _IC策画基础(流程、工艺、领土、器件)1、我们公司的产品是集电路,请描写一下对集电路的认识,罗列一些与集电路相关的形式(如讲了解模仿、数字、双极型、CMOS、MCU、RISC、CISC、DSP、ASIC、FPGA等的概念)。(仕兰微面试标题)2、FPGA和ASIC的概念,他们的区别。(未知)答案:FPGA是可编程ASIC。ASIC:公用集电路,它是面向特地用处的电路,特地为一个用户策画和制造的。根据一个用户的特定央求,能以低研制本钱,短、货周期供货的全定制,半定制集电路。与门阵列等其它ASIC(Application Specific IC)相比,它们又具有策画开发周期短、策画制造本钱低、开发工具先辈、轨范产品无需测试、质量稳定以及可实时在线检验等益处3、什么叫做OTP片、掩膜片,两者的区别何在?(仕兰微面试标题)4、知道的集电路策画的表达方式有哪几种?(仕兰微面试 标题)5、描写对集电路策画流程的认识。(仕兰微面试标题)6、简述FPGA等可编程逻辑器件策画流程。(仕兰微面试标题)7、IC策画前端到后端的流程和eda工具。(未知)8、从RTL synthesis到tape out之间的策画flow,并列出其中各步使用的tool.(未知)9、Asic的design flow。(威盛VIA 2003.11.06上海口试试题)10、写出asic后期策画的流程和相应的工具。(威盛)11、集电路前段策画流程,写出相关的工具。(扬智电子口试)先先容下IC开发流程:1.)代码输入(design input)用vhdl或者是verilog措辞来完器件的用描写,生hdl代码措辞输入工具:SUMMIT VISUALHDL MENTOR RENIOR图形输入:composer(cadence);viewlogic(viewdraw)2.)电路仿真(circuit simulation) 将vhd代码举办先前逻辑仿真,考证用描写能否正确数字电路仿真工具:Verolog:CADENCE Verolig-XL SYNOPSYS VCS MENTOR Modle-sim VHDL: vhdl SYNOPSYS VSS MENTOR Modle-sim模仿电路仿真工具:*ANTI CADENCE NC- HSpice pspice,spectre micro microwave:eesoft:hp 3.)逻辑分析(synthesis tools)逻辑分析工具可能将策画思想vhd代码转化对应一定工艺手段的门级电路;将初级仿真中所没有探究的门沿(gates delay)反标到生的门级网表中,前往电路仿真阶段举办再仿真。最终仿真真相生的网表称为物理网表。12、请简述一下策画后端的整个流程?(仕兰微面试标题)13、能否接触过主动布线?请说出一两种工具软件。主动布线须要哪些根基元素?(仕兰微面试标题)14、描写对集电路工艺的认识。(仕兰微面试标题)15、罗列几种集电路典型工艺。工艺上常提到0.25,0.18指的是什么?(仕兰微面试标题)16、请描写一下国际的工艺现状。(仕兰微面试标题)17、半导体工艺中,掺杂有哪几种方式?(仕兰微面试标题)18、描写CMOS电路中闩锁效应发作的过程及末了的真相?(仕兰微面试标题)19、疏解latch-up形势和Antenna effect和其防止.(未知)20、什么叫Latchup?(科广试题)21、什么叫窄沟效应?(科广试题)22、什么是NMOS、PMOS、CMOS?什么是加强型、耗尽型?什么是PNP、NPN?他们有什么差别?(仕兰微面试标题)23、硅栅COMS工艺中N阱中做的是P管还是N管,N阱的阱电位的连接有什么央求?(仕兰微面试标题)24、画出CMOS晶体管的CROSS-OVER图(应当是纵剖面图),给出全盘可能的传输特和转移特。(Infineon口试试题)25、以interver为例,写出N阱CMOS的process流程,并画出剖面图。(科广试题)26、Please explain how we describe the resistance in semiconductor.Compare the resistance of ametal,poly and diffusion in tranditional CMOS process.(威盛口试题circuit design-beijing- 03.11.09)27、说明mos一半作事在什么区。(凹凸的标题和面试)28、画p-bulk的nmos截面图。(凹凸的标题和面试)29、写schematic note(?),越多越好。(凹凸的标题和面试)30、寄收效应在ic策画中怎样加以克制和使用。(未知)31、太底层的MOS管物理特想通常不大会作为口试面试题,由于全是微电子物理,公式推导太罗索,除非面试出题的是个老学究。IC策画的话须要熟习的软件:Cadence,Synopsys,Avant,UNIX当然也要也许会作。32、unix命令cp-r,rm,uname。(扬智电子口试)_ _单片机、MCU、计算机原理1、大略描写一个单片机体例的主要组模块,并说明各模块之间的数据流流向和控制流流向。简述单片机应用体例的策画原则。(仕兰微面试标题)2、画出8031与2716(2K*8ROM)的连线图,央求采用三-八译码器,8031的P2.5,P2.4和P2.3插足译码,基当地址限制为3000H-3FFFH。该2716有没有堆叠地址?根据是什 若有,则写出每片2716的堆叠地址限制。(仕兰微面试标题)3、用8051策么? 画一个带一个8*16键盘加驱动八个数码管(共阳)的原理图。(仕兰微面试标题)4、PCI总线的含义是什么?PCI总线的主要特征是什么?(仕兰微面试标题)5、停止的概念?简述停止的历程。(仕兰微面试标题)6、如单片机停止几个/类型,编停止程序注意什么问题;(未知)7、要用一个开环脉冲调速体例来控制直流电念头的转速,程序由8051完。大略原理如下:由P3.4输入脉冲的占空比来控制转速,占空比越大,转速越快;而占空比由K7-K0八个开关来设置,间接与P1口相连(开关拨到下方时为"0",拨到上方时为"1",组一个八位二进制数N),央求占空比为N/256。(仕兰微面试标题)上面程序用计数来竣工这一用,请将空余部门添完善。MOV P1,#0FFH LOOP1:MOV R4,#0FFH--MOV R3,#00H LOOP2:MOV A,P1--SUBB A,R3 JNZ SKP1--SKP1:MOV C,70H MOV P3.4,C ACALL DELAY:此延时子程序略----AJMP LOOP1 8、单片机上电后没有运转,首先要搜检什么?(东信口试题)9、What is PC Chipset?(扬智电子口试)芯片组(Chipset)是主板的中心组部门,服从在主板上的胪列位置的不同,通常分为北桥芯片和南桥芯片。北桥芯片提供对CPU的类型和主频、内存的类型和最大容量、ISA/PCI/AGP插槽、ECC纠错等支撑。南桥芯片则提供对KBC(键盘控制器)、RTC(实时时钟控制器)、USB(通用串行总线)、Ultra DMA/33(66)EIDE数据传输方式和ACPI(初级动力管理)等的支撑。其中北桥芯片起着主导的作用,也称为主桥(Host Bridge)。除了最通用的南北桥外,目前芯片组正向更初级的加快集线架构发达,Intel的8xx系列芯片组就是这类芯片组的代表,它将一些子体例如IDE接口、音效、MODEM和USB直接接入主芯片,能够提供比PCI总线宽 一倍的带宽,抵达了266MB/s。10、假使简历上还说做过cpu之类,就会问到诸如cpu如何作事,流水线之类的问题。(未知)11、计算机的根基组部门及其各自的作用。(东信口试题)12、请画出微机接口电路中,典型的输入设备与微机接口逻辑默示图(数据接口、控制接口、所存器/缓冲器)。(汉王口试)13、cache的主要部门什么的。(威盛VIA 2003.11.06上海口试试题)14、同步异步传输的区别(未知)15、串行通讯与同步通讯异同,特征,比力。(华为面试题)16、RS232c高电平脉冲对应的TTL逻辑是?(负逻辑?)(华为面试题)_ _信号与体例1、的话音频次通常为300~3400HZ,若对其采样且使信号不失真,其最小的采样频次应为多大?若采用8KHZ的采样频次,并采用8bit的PCM编码,则存储一秒钟的信号数据量有多大?(仕兰微面试标题)2、什么耐奎斯特定律,怎样由模仿信号转为数字信号。(华为面试题)3、假使模仿信号的带宽为5khz,要用8K的采样 、信号与体例:在时域与频域关联。(华为面试率,怎样办?(lucent)两路?4 题)5、给出时域信号,求其直流重量。(未知)6、给出一时域信号,央求(1)写出频次重量,(2)写出其傅立叶变换级数;(3)当波形经过低通滤波器滤掉高次谐波而只保存一次谐波时,画出滤波后的输入波形。(未知)7、sketch连续正弦信号和连续矩形波(都有图)的傅立叶变换。(Infineon口试试题)8、拉氏变换和傅立叶变换的表达式及联系。(新太硬件面题)_ _DSP、嵌入式、软件等1、请用方框图描写一个熟习的适用数字信号料理体例,并做扼要的理会;假使没有,也可能自己策画一个大略的数字信号料理体例,并描写其用及用处。(仕兰微面试题目)2、数字滤波器的分类和特征。(仕兰微面试标题)3、IIR,FIR滤波器的异同。(新太硬件面题)4、拉氏变换与Z变换公式等类似东西,随意马虎翻翻把如.h(n)=-a*h(n-1)+b*δ(n)a.求h(n)的z变换;b.问该体例能否为稳定体例;c.写出FIR数字滤波器的差分方程;(未知)5、DSP和通用料理器在上有什么不同,请扼要画出熟习的一种DSP图。(信威dsp软件面试题)6、说说定点DSP和浮点DSP的定义(或者说出他们的区别)(信威dsp软件面试题)7、说说对循环寻址和位反序寻址的理解.(信威dsp软件面试题)8、请写出【-8,7】的二进制补码,和二进制偏置码。用Q15表示出0.5和-0.5.(信威dsp软件面试题)9、DSP的(哈佛);(未知)10、嵌入式料理器类型(如ARM),作体例品种(Vxworks,ucos,winCE,linux),作系统方面偏CS方向了,在CS篇内里讲了;(未知)11、有一个LDO芯片将用于对手机供电,须要对他举办评价,将如何策画的测试项目?12、某程序在一个嵌入式体例(200MCPU,50M SDRAM)中一经最化了,换到零一个系统(300M CPU,50M SDRAM)中能否还须要化?(Intel)13、请扼 要描写HUFFMAN编码的根基原理及其根基的竣工方。(仕兰微面试标题)14、说出OSI七层网络中的层(任意层)。(仕兰微面试标题)15、A)(仕兰微面试标题)#i nclude void testf(int*p){*p+=1;}main(){int*n,m[2];n=m;m[0]=1;m[1]=8;testf(n);printf("Data value is%d",*n);}--B)#i nclude void testf(int*p){*p+=1;}main(){int*n,m[2];n=m;m[0]=1;m[1]=8;testf(&n);printf(Data value is%d",*n);}上面的真相是程序A还是程序B的?Data value is 8那么另一段程序的真相是什么?16、那种排序方最快?(华为面试题)17、写出两个排序算,问哪个好?(威盛)18、编一个大略的求n~的程序。(Infineon口试试题)19、用一种编程措辞写n~的算。(威盛VIA 2003.11.06上海口试试题)20、用C措辞写一个递归算求N~;(华为面试题)21、给一个C的函数,关于字符串和数组,找出毛病;(华为面试题)22、防火墙是 、对哪方面编程熟习?(华为面试题)24、冒泡排序怎样竣工的?(华为面试题)23 的原理。(新太硬件面题)25、作体例的用。(新太硬件面题)26、学过的计算机措辞及开发的体例。(新太硬件面题)27、一个农夫浮现围正方形的围栏比长方形的减省4个木桩但是面积一样.羊的数目和正方形围栏的桩子的个数一样但是小于36,问有若干好多羊?(威盛)28、C措辞竣工统计某个cell在某.v文件调用的次数(这个标题真bt)(威盛VIA 2003.11.06上海口试试题)29、用C措辞写一段控制手机中马达振子的驱动程序。(威胜)30、用perl或TCL/Tk竣工一段字符串判别和比力的程序。(未知)31、给出一个堆栈的,求停止后显示真相,主要是考堆栈压入前往地址寄生计低端地址还是高端。(未知)32、一些DOS命令,如显示文件,拷贝,删除。(未知)33、策画一个类,使得该类任何形式的派生类不论怎样定义和竣工,都无发作任何对象实例。(IBM)34、What is pre-emption?(Intel)35、What is the state of aprocess if aresource is not available?(Intel)36、三个float a,b,c;问值(a+b)+c==(b+a)+c,(a+b)+c==(a+c)+b。(Intel)37、把一个链表反向填空。(lucent)38、x^4+a*x^3+x^2+c*x+d最少须要做几次乘?(Dephi)_ _客观题1、以为处置研发作事有哪些特征?(仕兰微面试标题)2、说出的最大弱点及厘正方。(威盛VIA 2003.11.06上海口试试题)3、说出的志向。说出想抵达的标的目的。标题是英文出的,要用英文答复。(威盛VIA 2003.11.06上海口试试题)4、我们将研发员分为若干研究方向,对协议和算理解(主要应用在网络通讯、图象语音紧缩方面)、电子体例计划的研究、用MCU、DSP编程竣工电路用、用ASIC策画技术策画电路(包括MCU、DSP自身)、电路用模块策画(包括模仿电路和数字电路)、集 电路后端策画(主要是指分析及主动布线技术)、集电路策画与工艺接口的研究。希望处置哪方面的研究?(可能遴选多个方向。另外,一经处置过相关研发的员可能详明描写的研发履历)。(仕兰微面试标题)5、请谈谈对一个体例策画的总体思绪。针对这个思绪,觉得应当齐全哪些方面的知识?(仕兰微面试标题)6、想象将策画完一个电子电路计划。请简述用EDA软件(如PROTEL)举办策画(包括原理图和PCB图)到调试出样机的整个历程。在各环节应注意哪些问题?电源的稳定,电容的选取,以及的大小。(汉王口试)配合的注意点1.通常状下,面试官主要根据的简历发问,所以一定要对自己职掌,把简历上的东西搞明白;2.个体雇用针对异常强,就招目前他们确的方向的,这种状下,就要投其所好,尽量先容其所关怀的东西。3.其实技术面试并不难,但是由于很多东西都忘掉了,才觉得有些难。所以最好在面试前把该看的书看看。4.固然说技术面试是 公司所专领域及喜欢不同,实力的较量与展现,但是不可否定,由于不消面试官/ 也有面试也有很大的肯定,须要和缓对于。不能由于被拒,就否定自己或指责公司。5.面试时要take it easy,对越是自己钟的公司越要这样。如果你感兴趣下面了解更多进口欧蓝德拆车件爽肤水09款欧蓝德远古文明如果你消失了文章来源地址: 特别声明: 1:资料来源于互联网,版权归属原作者 2:资料内容属于网络意见,与本账号立场无关 3:如有侵权,请告知,立即删除。
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